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　　金融界2024年12月24日信息，国度常识产权局音信显示，意法半导体国际公司申请一项名为“全速拘捕下的功耗下降和有用时序破例处分”的专利，公然号 CN 119167851 A，申请日期为 2024 年 6 月。

　　专利摘要显示，本公然涉及全速拘捕下的功耗下降和有用时序破例处分。更详细而言，遵循推行例，供应了一种用于测试扫描链的措施。该措施搜罗采纳第暂时钟信号和第一扫描使能信号，并基于第暂时钟信号和第一扫描使能信号天生第二时钟信号和第三时钟信号。第三时钟信号从第二时钟信号延迟一个时钟脉冲。第暂时钟信号、第二时钟信号和第三时钟信号拥有相像的占空比。该措施还搜罗分歧向扫描链的第一扫描触发器的时钟端子和扫描使能输入端供应第二时钟信号和第二扫描使能信号。该措施还搜罗分歧向扫描链的末了一个扫描触发器的时钟端子和扫描使能输入端供应第三时钟信号和第三扫描使能信号。